Lines Matching refs:clkr
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2675 [MMPLL0] = &mmpll0.clkr,
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2691 [BYTE0_CLK_SRC] = &byte0_clk_src.clkr,
2692 [BYTE1_CLK_SRC] = &byte1_clk_src.clkr,
2693 [CCI_CLK_SRC] = &cci_clk_src.clkr,
2694 [CPP_CLK_SRC] = &cpp_clk_src.clkr,
2695 [CSI0_CLK_SRC] = &csi0_clk_src.clkr,
2696 [CSI1_CLK_SRC] = &csi1_clk_src.clkr,
2697 [CSI2_CLK_SRC] = &csi2_clk_src.clkr,
2698 [CSI3_CLK_SRC] = &csi3_clk_src.clkr,
2699 [CSIPHY_CLK_SRC] = &csiphy_clk_src.clkr,
2700 [CSI0PHYTIMER_CLK_SRC] = &csi0phytimer_clk_src.clkr,
2701 [CSI1PHYTIMER_CLK_SRC] = &csi1phytimer_clk_src.clkr,
2702 [CSI2PHYTIMER_CLK_SRC] = &csi2phytimer_clk_src.clkr,
2703 [DP_AUX_CLK_SRC] = &dp_aux_clk_src.clkr,
2704 [DP_CRYPTO_CLK_SRC] = &dp_crypto_clk_src.clkr,
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2707 [ESC0_CLK_SRC] = &esc0_clk_src.clkr,
2708 [ESC1_CLK_SRC] = &esc1_clk_src.clkr,
2709 [EXTPCLK_CLK_SRC] = &extpclk_clk_src.clkr,
2710 [FD_CORE_CLK_SRC] = &fd_core_clk_src.clkr,
2711 [HDMI_CLK_SRC] = &hdmi_clk_src.clkr,
2712 [JPEG0_CLK_SRC] = &jpeg0_clk_src.clkr,
2713 [MAXI_CLK_SRC] = &maxi_clk_src.clkr,
2714 [MCLK0_CLK_SRC] = &mclk0_clk_src.clkr,
2715 [MCLK1_CLK_SRC] = &mclk1_clk_src.clkr,
2716 [MCLK2_CLK_SRC] = &mclk2_clk_src.clkr,
2717 [MCLK3_CLK_SRC] = &mclk3_clk_src.clkr,
2718 [MDP_CLK_SRC] = &mdp_clk_src.clkr,
2719 [VSYNC_CLK_SRC] = &vsync_clk_src.clkr,
2720 [AHB_CLK_SRC] = &ahb_clk_src.clkr,
2721 [AXI_CLK_SRC] = &axi_clk_src.clkr,
2722 [PCLK0_CLK_SRC] = &pclk0_clk_src.clkr,
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2724 [ROT_CLK_SRC] = &rot_clk_src.clkr,
2725 [VIDEO_CORE_CLK_SRC] = &video_core_clk_src.clkr,
2726 [VIDEO_SUBCORE0_CLK_SRC] = &video_subcore0_clk_src.clkr,
2727 [VIDEO_SUBCORE1_CLK_SRC] = &video_subcore1_clk_src.clkr,
2728 [VFE0_CLK_SRC] = &vfe0_clk_src.clkr,
2729 [VFE1_CLK_SRC] = &vfe1_clk_src.clkr,
2730 [MISC_AHB_CLK] = &misc_ahb_clk.clkr,
2731 [VIDEO_CORE_CLK] = &video_core_clk.clkr,
2732 [VIDEO_AHB_CLK] = &video_ahb_clk.clkr,
2733 [VIDEO_AXI_CLK] = &video_axi_clk.clkr,
2734 [VIDEO_MAXI_CLK] = &video_maxi_clk.clkr,
2735 [VIDEO_SUBCORE0_CLK] = &video_subcore0_clk.clkr,
2736 [VIDEO_SUBCORE1_CLK] = &video_subcore1_clk.clkr,
2737 [MDSS_AHB_CLK] = &mdss_ahb_clk.clkr,
2738 [MDSS_HDMI_DP_AHB_CLK] = &mdss_hdmi_dp_ahb_clk.clkr,
2739 [MDSS_AXI_CLK] = &mdss_axi_clk.clkr,
2740 [MDSS_PCLK0_CLK] = &mdss_pclk0_clk.clkr,
2741 [MDSS_PCLK1_CLK] = &mdss_pclk1_clk.clkr,
2742 [MDSS_MDP_CLK] = &mdss_mdp_clk.clkr,
2743 [MDSS_MDP_LUT_CLK] = &mdss_mdp_lut_clk.clkr,
2744 [MDSS_EXTPCLK_CLK] = &mdss_extpclk_clk.clkr,
2745 [MDSS_VSYNC_CLK] = &mdss_vsync_clk.clkr,
2746 [MDSS_HDMI_CLK] = &mdss_hdmi_clk.clkr,
2747 [MDSS_BYTE0_CLK] = &mdss_byte0_clk.clkr,
2748 [MDSS_BYTE1_CLK] = &mdss_byte1_clk.clkr,
2749 [MDSS_ESC0_CLK] = &mdss_esc0_clk.clkr,
2750 [MDSS_ESC1_CLK] = &mdss_esc1_clk.clkr,
2751 [MDSS_ROT_CLK] = &mdss_rot_clk.clkr,
2752 [MDSS_DP_LINK_CLK] = &mdss_dp_link_clk.clkr,
2753 [MDSS_DP_LINK_INTF_CLK] = &mdss_dp_link_intf_clk.clkr,
2754 [MDSS_DP_CRYPTO_CLK] = &mdss_dp_crypto_clk.clkr,
2755 [MDSS_DP_PIXEL_CLK] = &mdss_dp_pixel_clk.clkr,
2756 [MDSS_DP_AUX_CLK] = &mdss_dp_aux_clk.clkr,
2757 [MDSS_BYTE0_INTF_CLK] = &mdss_byte0_intf_clk.clkr,
2758 [MDSS_BYTE1_INTF_CLK] = &mdss_byte1_intf_clk.clkr,
2759 [CAMSS_CSI0PHYTIMER_CLK] = &camss_csi0phytimer_clk.clkr,
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2767 [CAMSS_CSI1_AHB_CLK] = &camss_csi1_ahb_clk.clkr,
2768 [CAMSS_CSI1RDI_CLK] = &camss_csi1rdi_clk.clkr,
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2801 [CAMSS_CSI_VFE0_CLK] = &camss_csi_vfe0_clk.clkr,
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2812 [FD_CORE_CLK] = &fd_core_clk.clkr,
2813 [FD_CORE_UAR_CLK] = &fd_core_uar_clk.clkr,
2814 [FD_AHB_CLK] = &fd_ahb_clk.clkr,
2815 [MNOC_AHB_CLK] = &mnoc_ahb_clk.clkr,
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2817 [BIMC_SMMU_AXI_CLK] = &bimc_smmu_axi_clk.clkr,
2818 [MNOC_MAXI_CLK] = &mnoc_maxi_clk.clkr,
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2820 [VMEM_AHB_CLK] = &vmem_ahb_clk.clkr,