Lines Matching defs:CMU_DEVRST0
63 #define CMU_DEVRST0 (0x00A8)
690 [RESET_DMAC] = { CMU_DEVRST0, BIT(0) },
691 [RESET_SRAMI] = { CMU_DEVRST0, BIT(1) },
692 [RESET_DDR_CTL_PHY] = { CMU_DEVRST0, BIT(2) },
693 [RESET_NANDC0] = { CMU_DEVRST0, BIT(3) },
694 [RESET_SD0] = { CMU_DEVRST0, BIT(4) },
695 [RESET_SD1] = { CMU_DEVRST0, BIT(5) },
696 [RESET_PCM1] = { CMU_DEVRST0, BIT(6) },
697 [RESET_DE] = { CMU_DEVRST0, BIT(7) },
698 [RESET_LVDS] = { CMU_DEVRST0, BIT(8) },
699 [RESET_SD2] = { CMU_DEVRST0, BIT(9) },
700 [RESET_DSI] = { CMU_DEVRST0, BIT(10) },
701 [RESET_CSI0] = { CMU_DEVRST0, BIT(11) },
702 [RESET_BISP_AXI] = { CMU_DEVRST0, BIT(12) },
703 [RESET_CSI1] = { CMU_DEVRST0, BIT(13) },
704 [RESET_GPIO] = { CMU_DEVRST0, BIT(15) },
705 [RESET_EDP] = { CMU_DEVRST0, BIT(16) },
706 [RESET_AUDIO] = { CMU_DEVRST0, BIT(17) },
707 [RESET_PCM0] = { CMU_DEVRST0, BIT(18) },
708 [RESET_HDE] = { CMU_DEVRST0, BIT(21) },
709 [RESET_GPU3D_PA] = { CMU_DEVRST0, BIT(22) },
710 [RESET_IMX] = { CMU_DEVRST0, BIT(23) },
711 [RESET_SE] = { CMU_DEVRST0, BIT(24) },
712 [RESET_NANDC1] = { CMU_DEVRST0, BIT(25) },
713 [RESET_SD3] = { CMU_DEVRST0, BIT(26) },
714 [RESET_GIC] = { CMU_DEVRST0, BIT(27) },
715 [RESET_GPU3D_PB] = { CMU_DEVRST0, BIT(28) },
716 [RESET_DDR_CTL_PHY_AXI] = { CMU_DEVRST0, BIT(29) },
717 [RESET_CMU_DDR] = { CMU_DEVRST0, BIT(30) },
718 [RESET_DMM] = { CMU_DEVRST0, BIT(31) },